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dc.date.accessioned 2025-02-26T16:44:56Z
dc.date.available 2025-02-26T16:44:56Z
dc.date.issued 2024
dc.identifier.uri http://sedici.unlp.edu.ar/handle/10915/176949
dc.description.abstract En este trabajo se describe el diseño e implementación, basado en dispositivos FPGA, de un sistema de procesamiento para la captura y transmisión de video crudo Radar. La comunicación de la información cumple con el protocolo ASTERIX, ampliamente adoptado a nivel mundial, principalmente para el control de tráfico aéreo. En este caso se utiliza la categoría CAT 240, siendo éste el estándar para transferencia de video crudo Radar. es
dc.format.extent 15-27 es
dc.language es es
dc.subject Video Radar es
dc.subject ASTERIX CAT 240 es
dc.subject FPGA es
dc.title Generación de datos ASTERIX CAT 240 mediante FPGA es
dc.type Objeto de conferencia es
sedici.identifier.uri https://revistas.unlp.edu.ar/JAIIO/article/view/18001 es
sedici.identifier.issn 2451-7496 es
sedici.creator.person Gálvez, Nélida es
sedici.creator.person Valdez, Marianp es
sedici.creator.person Cayssials, Ricardo es
sedici.subject.materias Ciencias Informáticas es
sedici.description.fulltext true es
mods.originInfo.place Sociedad Argentina de Informática e Investigación Operativa es
sedici.subtype Objeto de conferencia es
sedici.rights.license Creative Commons Attribution-NonCommercial-ShareAlike 4.0 International (CC BY-NC-SA 4.0)
sedici.rights.uri http://creativecommons.org/licenses/by-nc-sa/4.0/
sedici.date.exposure 2024-08
sedici.relation.event Simposio Argentino en Ingeniería en Computación (SAIC 2024) - JAIIO 53 (Universidad Nacional del Sur, 12 al 16 de agosto de 2024) es
sedici.description.peerReview peer-review es


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