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dc.date.accessioned 2012-09-28T13:15:49Z
dc.date.available 2012-09-28T13:15:49Z
dc.date.issued 2001
dc.identifier.uri http://sedici.unlp.edu.ar/handle/10915/21741
dc.description.abstract En éste artículo se presenta una herramienta para la generación automática de multiplicadores paralelos en VHDL para síntesis. Se intenta asistir al diseñador de DSP a medida sobre plataformas FIPSOC (de Sidsa) o Virtex (de Xilinx). Se generan los siete multiplicadores: McCanny - McWhirter, De Mori, Hatamian y Cash, Ripple Carry, Carry Save, Guild y De Mori – Guild; con y sin pipelining. es
dc.language es es
dc.subject generación automática de circuitos es
dc.subject Parallel circuits es
dc.subject Visual es
dc.subject síntesis de circuitos es
dc.subject CAE es
dc.subject Signal processing es
dc.subject multiplicación es
dc.title Generación automática de circuitos paralelos de multiplicación para DSP a medida de la aplicación es
dc.type Objeto de conferencia es
sedici.creator.person Acosta, Nelson es
sedici.creator.person Collado, Cecilia es
sedici.description.note Eje: Procesamiento de Señales – Visión es
sedici.subject.materias Ciencias Informáticas es
sedici.description.fulltext true es
mods.originInfo.place Red de Universidades con Carreras en Informática (RedUNCI) es
sedici.subtype Objeto de conferencia es
sedici.rights.license Creative Commons Attribution-NonCommercial-ShareAlike 2.5 Argentina (CC BY-NC-SA 2.5)
sedici.rights.uri http://creativecommons.org/licenses/by-nc-sa/2.5/ar/
sedici.date.exposure 2001-05 es
sedici.relation.event III Workshop de Investigadores en Ciencias de la Computación es
sedici.description.peerReview peer-review es


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Creative Commons Attribution-NonCommercial-ShareAlike 2.5 Argentina (CC BY-NC-SA 2.5) Excepto donde se diga explícitamente, este item se publica bajo la siguiente licencia Creative Commons Attribution-NonCommercial-ShareAlike 2.5 Argentina (CC BY-NC-SA 2.5)