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dc.date.accessioned 2014-07-15T19:14:56Z
dc.date.available 2014-07-15T19:14:56Z
dc.date.issued 2013
dc.identifier.uri http://sedici.unlp.edu.ar/handle/10915/37987
dc.description.abstract El objetivo de este trabajo es desarrollar un Sistema Embebido sobre una FPGA, para la corrección de errores en caracteres alfanuméricos representados en una matriz de pixeles LCD de 5x8. Los caracteres alfanuméricos serán obtenidos a partir de una comunicación USB con una PC, y luego de recibidos se modificará aleatoriamente 2 pixeles. Finalmente se entregarán los caracteres con errores uno por uno al Bloque de Corrección de Errores donde se procesarán para recobrar el carácter original. Los resultados se presentarán en un LCD de 2 Líneas con representación de caracteres en una matriz de 5x8 pixeles. es
dc.format.extent 390-391 es
dc.language es es
dc.title Sistema embebido para corrección de errores implementado en lógica programable es
dc.type Objeto de conferencia es
sedici.creator.person Capossio, Leonardo es
sedici.creator.person Osio, Jorge Rafael es
sedici.creator.person Aróztegui, Walter J. es
sedici.creator.person Rapallini, José Antonio es
sedici.subject.materias Ingeniería es
sedici.description.fulltext true es
mods.originInfo.place Facultad de Ingeniería es
sedici.subtype Objeto de conferencia es
sedici.rights.license Creative Commons Attribution 3.0 Unported (CC BY 3.0)
sedici.rights.uri http://creativecommons.org/licenses/by/3.0/
sedici.date.exposure 2013-05
sedici.relation.event II Jornadas de Investigación y Transferencia de la Facultad de Ingeniería (ITE) (La Plata, 2013) es
sedici.description.peerReview peer-review es


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