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dc.date.accessioned 2017-05-15T12:23:18Z
dc.date.available 2017-05-15T12:23:18Z
dc.date.issued 2017-05-15
dc.identifier.uri http://sedici.unlp.edu.ar/handle/10915/60156
dc.description.abstract Los análisis y comparaciones desarrollados en el presente trabajo tienen como objetivo lograr estimaciones de tiempos de subida y bajada y tiempos de propagación de una compuerta inversora diseñada en tecnología CMOS de 500 nm sin carga. Esta propuesta se enmarca en un proyecto mayor, el cual tiene como fin el diseño de una librería de celdas CMOS (compuertas estáticas, biestables, etc) y la correspondiente caracterización de cada uno de sus componentes. es
dc.format.extent 344-349 es
dc.language es es
dc.subject análisis de tiempos es
dc.subject tecnología CMOS es
dc.title Análisis de capacidades y estimación de tiempos de un inversor CMOS es
dc.type Objeto de conferencia es
sedici.identifier.isbn 978-950-34-1453-8 es
sedici.creator.person Ricci, Edgardo es
sedici.creator.person Agostini, Marcial es
sedici.creator.person Serrangeli, Juan es
sedici.creator.person Aróztegui, Walter J. es
sedici.creator.person Rapallini, José Antonio es
sedici.creator.person Quijano, María Victoria es
sedici.creator.person Quijano, Antonio Adrián es
sedici.description.note Sección: Electrotecnia. es
sedici.subject.materias Electrotecnia es
sedici.description.fulltext true es
mods.originInfo.place Facultad de Ingeniería es
sedici.subtype Resumen es
sedici.rights.license Creative Commons Attribution 4.0 International (CC BY 4.0)
sedici.rights.uri http://creativecommons.org/licenses/by/4.0/
sedici.date.exposure 2017-04
sedici.relation.event IV Jornadas de Investigación, Transferencia y Extensión de la Facultad de Ingeniería (La Plata, 2017) es
sedici.description.peerReview peer-review es


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